14微米叠十层几乎0偏移！浦项科大把芯片堆叠密度干到HBM四倍
浦项科技大学团队开发出超薄芯片堆叠技术，将约14微米厚的硅芯片堆叠10层以上，集成密度达现有HBM的四倍。该技术通过整合转移印刷与实时键合，在低温低压下实现低误差、低翘曲，为AI半导体、Chiplet封装及MicroLED提供新路径。
超薄芯片堆叠技术突破：HBM密度有望提升4倍
先说几个核心判断：HBM（高带宽存储器）的性能几乎直接决定了AI半导体的天花板，而HBM的关键又在于多层存储芯片的垂直堆叠——堆得层数越多，性能越强，但芯片越薄就越难伺候。这个死循环，现在被浦项科技大学团队找到了解法。
快科技7月8日消息，由机械工程系金锡教授、金宇铉博士生以及韩国工业技术研究院金浩铉博士共同完成的研究，近日宣布开发出一种超薄半导体芯片的稳定堆叠技术。集成密度直接飙到现有HBM的约4倍——这可不是小修小补，而是为高性能AI半导体铺出了一条新路。
问题到底出在哪？说白了，芯片越薄越脆。厚度只有几十微米甚至更薄的时候，传统工艺基本失效——弯曲、断裂成了家常便饭。这层天花板，多年来一直压着HBM的层数突破。
这次的核心思路很巧妙：把转移印刷和实时键合两种技术整合到同一个工艺平台上。转移印刷负责把芯片精准挪到指定位置，实时键合则在芯片转移的瞬间同步完成金属连接。芯片转移、贴装、电气连接三道工序合为一体——从根源上解决了超薄芯片在操作中的易损难题。
具体数据更直观：团队在低于180摄氏度、低于20千帕的温和条件下，成功堆叠了厚度约14微米的超薄硅芯片，10层以上。14微米什么概念？大约是一根头发丝的五分之一。堆叠完成后，层间对位误差极小，芯片翘曲被大幅抑制。同样封装高度内能塞进的芯片数量自然就上去了。
这项技术不光盯着AI半导体，它还能用在Chiplet（小芯片）封装和Micro LED显示器领域。相关成果已经发表在《Results in Engineering》网络版。行业分析普遍认为，从材料工艺到集成方案，这波操作给后摩尔时代的芯片堆叠提供了一条全新的技术路径。
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